Tilera揭幕64核心基于滤网的处理器
现今我们是谈话二重奏核心，方形字体核心甚至许多核心为力量饥饿的hyperthreading和多重处理。 然而，总有设计，并且费用限制在放更多核心入同样死。 为了打破界限， Tilera Corporation有出来了与概念证明设计，以使用网状网络互联公共汽车在一块唯一芯片集成64个核心的TILE64著名。
聪明的滤网互联，以iMesh著名被认为能一起连接数百甚至数以万计核心，当允许并行处理执行必要的任务时。 惊奇地，每个核心在它自己热忱的OS可能跑例如Linux或窗口，当由L1和L2进一步改进潜在因素和整体表现的贮藏所时支持。 其外，有被埋置入芯片的四个DDR2记忆控制器减少脚印。 那不是全部，您将是能发现某个遗产IO接口例如I2C、UART、SPI和均匀PCIe和GbE口岸为互联与外在芯片。
一些可以感兴趣知道核心我们谈在这儿是否于实际英特尔或AMD核心是相似的那我们知交与。 它不也许在苹果到苹果比较，但是大规模大小在嵌入系统世界预计极大改进处理能力。 与当前核心处理器的速度从600MHz在商业市场上范围到900MHz，我们应该准备看更高的核心频率超出1GHz在不久的将来中。
重要: 这是现状提供，不用保单的机器翻译的页。 计算机翻译也许是难了解。 参见 原始的英国文章 每当可能。
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